전자공학
SR 래치의 진리표
무에서
2018. 6. 6. 21:11
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SR 래치 (Set-Reset Latch)의 논리 회로는 다음 그림과 같다.
SR 래치의 진리표는 다음과 같다. /S이 0일 때 Q는 1이 되고 /R이 0일 때 Q는 0이 되며 /S과 /R이 모두 1일 때는 이전 상태를 유지한다. /S과 /R이 모두 0이 되면 어떤 상태가 될 지 알 수 없기 때문에 /S과 /R이 모두 0이 되지 않도록 사용해야 한다.
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